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CPU的JTAG口是個什么東西
我們看到很多芯片，都有一個JTAG口，這是干什么用的呢?
JTAG(Joint Test Action Group)聯(lián)合測試工作組。是一種標(biāo)準(zhǔn)測試協(xié)議，主要用于芯片內(nèi)部的測試兼容IEEE 1149.1協(xié)議，很多的高級芯片均具有這個協(xié)議，如FPGA、DSP等。
JTAG口一開始只是用來對芯片內(nèi)部進(jìn)行測試的，他的原理就是在器件內(nèi)部定義一個名為TAP(Test Access Port)測試訪問口,然后通過專用的工具對內(nèi)部進(jìn)行測試。現(xiàn)在，通過JTAG可對芯片內(nèi)部的所有部件進(jìn)行編程控制。
下面我們來介紹一下JTAG口的接口定義!
JTAG口有很多的封裝，比如10腳、14腳和20腳，盡管引腳的數(shù)目和排序不同，但都是大同小異!
IEEE1149.1標(biāo)準(zhǔn)里是強(qiáng)制要求的如下：
1、TCK(Test Clock Input)--JTAG口時鐘腳
測試時鐘輸入腳為TAP的操作提供了一個獨立的、基本的時鐘信號，TAP的所有操作都是通過這個時鐘信號來驅(qū)動的。
2、TMS (Test Mode Selection Input) -----測試模式選擇輸入腳
TMS信號可以控制TAP在不同的狀態(tài)之間進(jìn)行相互轉(zhuǎn)換，此信號在TCK的上升沿有效。
3、TDI (Test Data Input) -----測試數(shù)據(jù)輸入腳
TDI是所有要輸入到特定寄存器的數(shù)據(jù)串行輸入的接口。
4、TDO (Test Data Output) -----測試數(shù)據(jù)輸出腳
TDO是所有要從特定的寄存器中輸出的數(shù)據(jù)串行輸出的接口。
5、 (VTREF) -----接口信號電平
接口信號電平可以用來確定ARM的JTAG接口使用的邏輯電平。
IEEE1149.1標(biāo)準(zhǔn)里是可選項的要求如下：
1、TRST (Test Reset Input) ----測試復(fù)位輸入腳
TRST信號可以執(zhí)行與TMS一樣的功能，即用來對TAPController進(jìn)行復(fù)位(初始化)。
2、RTCK(Return Test Clock ) ----反饋測試時鐘
此腳是用來同步TCK信號的，由目標(biāo)端反饋給仿真器的時鐘信號，在不使用時直接接地。
3、nSRST (System Reset )----時鐘復(fù)位信號反饋腳
此腳可以檢測目標(biāo)系統(tǒng)的復(fù)位情況同時也可與目標(biāo)板上的系統(tǒng)復(fù)位信號相連,直接對目標(biāo)系統(tǒng)復(fù)位。建議為了防止誤觸發(fā)應(yīng)在目標(biāo)端加上適當(dāng)?shù)纳侠娮琛?/p>
4、USER IN--用戶自定義輸入
此腳可以接到目標(biāo)機(jī)的一個IO上，用來接受上位機(jī)的控制。
5、USER OUT--用戶自定義輸出
此腳可以接到目標(biāo)機(jī)的一個IO上，用來向上位機(jī)的反饋一個狀態(tài)。
實際上，這些可以選擇的腳，一般都是不使用的，在實際應(yīng)用中出現(xiàn)的20線等口，主要是為了增加地線，減小JTAG的干擾而出現(xiàn)的。
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